
Ingénieur ESD et analyse de défaillances
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Ingénieur Process /Rendement at STMicroelectronics (2018-12 – 2024-11)
Analyse de rendement et amélioration des process de fabrication en technologie BICMOS 0.25/0.13um. Dans ce travail, ont été incluses les phases suivantes :
Ingénieur développement ESD at AMS (2016-01 – 2018-11)
Participation au développement de nouvelles librairies de composant de protection ESD, caractérisations et analyse de défaillances. Ce travail m' a permis d étendre mon expertise dans les domaines qui sont :
Ingénieur développement composant at Murata (2010-09 – 2014-09)
Développement de structures de protection contre les décharges électrostatiques (ESD) fortement intégrées sur silicium. Dans ce travail, ont été incluses les phases suivantes :
Doctorat GEET 2014 in Génie électrique, électronique et des télécommunications (2014)
Master professionnel ICEM in Intégration des circuits électroniques et microélectroniques
Licence EEA in Ingénierie électrique
DUT GEII in Génie électrique et informatique industrielle, option électronique