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回路設計-デジタル(FPGA)回路設計

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株式会社 アドバンテスト
明和町, 日本最低 ¥4,500,000 /年5日前まで 2026/12/9
正社員

職務内容

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仕事内容

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【群馬】デジタル回路設計オープンポジション◇半導体試験装置世界シェア1位/舘林熊谷からアクセス◎

【U・Iターン歓迎!転居を伴う場合、引っ越し手当有!/半導体試験装置世界トップ級シェア/熊谷・館林近く※マイカー通勤可】 ■概要: 半導体テスタ用のデジタル回路設計エンジニアとして活躍いただきます。開発品種拡大と、開発サイクル強化のための増員募集です。論理回路ユニット、自己診断プログラムおよび校正プログラムの開発エンジニアとして関わる予定です。 当社テクノロジー開発本部は複数の部門で回路開発をおこなっており、関わる製品等によって部門が分かれております。選考を通じて、ご本人の適性を見ながら最適なポジションを判断いたします。 ■業務詳細: ・ASIC/FPGAのデジタル回路設計(Verilog-HDL, SystemVerilog) ・診断プログラム開発、およびハードウェア評価 ■やりがい: ・仕様決定、設計、検証、評価と製品開発の初期からリリースまでの一連の業務に携わることができ、とてもやりがいがあり、達成感を得られます。 ・グループで活発に話し合いながら業務を進めるため、和気あいあいとしており、学びの機会も得られ成長しやすい環境です。 ・若手からベテランまでバランスよく構成されており、フォロー体制が整っています。 ・コミュニケーションの取り易さから勤務形態は出社が主体です。配属部門によりますが、中には週1~2回テレワークするメンバーもいます。 ■働き方: 月平均残業は20~30h程度です。在宅勤務可能(フルリモートは不可)で、フレックスも使いながら柔軟に働けます。 ■同社について: 「先端技術を先端で支える」という企業理念のもと、進展著しいデジタル社会のインフラストラクチャーである半導体の品質や信頼性の向上を通じて、社会の持続可能な発展に寄与しています。主力製品となる半導体試験装置は世界シェア1位で、海外売上高比率は9割を超えています。健康経営優良法人(ホワイト500)にも5年連続で認定されていて、ダイバーシティ・ワークライフバランスへの取り組みも多数行っています。高い専門性がありながら、働きやすさを両立できる体制です。 変更の範囲:会社の定める業務

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対象となる方

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<最終学歴>大学院、大学、高等専門学校卒以上

<応募資格/応募条件> ■必須条件: ・論理回路設計の経験をお持ちの方(ASIC、FPGAなど) ・Verilog-HDLやSystemVerilogなどのHDLによる設計経験をお持ちの方 ■歓迎要件: ・C言語やC などでのソフトウェア開発の経験をお持ちの方 ・英語力(抵抗のないレベル)

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勤務地

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<勤務地詳細> 群馬R&Dセンタ 住所:群馬県邑楽郡明和町大輪336-1 勤務地最寄駅:東武伊勢崎線/川俣駅 受動喫煙対策:屋内全面禁煙 変更の範囲:会社の定める事業所(リモートワーク含む)

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勤務時間

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<労働時間区分> フレックスタイム制 コアタイム:11:00~14:00 フレキシブルタイム:6:00~11:00、14:00~22:00 休憩時間:60分 時間外労働有無:有 <標準的な勤務時間帯> 8:45~17:30

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雇用形態

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正社員

<雇用形態補足> 期間の定め:無 <試用期間> 3ヶ月

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給与

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<予定年収> 480万円~1,100万円 <賃金形態> 月給制 <賃金内訳> 月額(基本給):250,000円~600,000円 <月給> 250,000円~600,000円 <昇給有無> 有 <残業手当> 有 <給与補足> ※スキル・経験等により個別に設定させていただきます。 ■昇給 : 年1回(6月) ■賞与 : 年2回(6月、12月)※2ケ月分×2回=約4ヵ月分想定 賃金はあくまでも目安の金額であり、選考を通じて上下する可能性があります。 月給(月額)は固定手当を含めた表記です。

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待遇・福利厚生

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通勤手当、住宅手当、寮社宅、健康保険、厚生年金保険、雇用保険、労災保険、厚生年金基金、退職金制度 <各手当・制度補足> 通勤手当:全額支給 住宅手当:家賃補助制度 寮社宅:借上社宅制度 社会保険:■各種保険完備 厚生年金基金:補足事項なし 退職金制度:補足事項なし <定年> 60歳 <教育制度・資格補助補足> ■OJT ■教育補助制度あり、その他各種英語研修、社内TOEIC(R)テストなど <その他補足> 各種社会保険、健康保険組合、企業年金基金、確定拠出年金、従業員持株制度、財形貯蓄制度、再雇用制度、育児休職制度、家賃補助制度、借上社宅制度、借上寮制度、引っ越し手当など

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休日・休暇

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完全週休2日制(休日は土日祝日) 年間有給休暇1日~22日(下限日数は、入社直後の付与日数となります) 年間休日日数127日 ■2023年度実績 GW(9日)/夏季休暇(9日)/年末年始(7日) ※有給休暇の付与数は、入社月により変わります

Keywords
VerilogSystemverilog

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